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第三代微處理器(1978-1982):16位微處理器,如Intel企業(yè)的8086、80286、Motorola的68000和Zilog的
Z8000?集成度達(dá)29000萬(wàn)只品體管,平均指令執(zhí)行時(shí)間0.5us(200ns),v
從大型計(jì)算機(jī)到微型計(jì)算機(jī),其基本構(gòu)造屬于馮.諾依曼構(gòu)造,即包括運(yùn)算器、控制器、存儲(chǔ)器、輸入設(shè)備和輸出
設(shè)備5個(gè)構(gòu)成部分。
8位帶符號(hào)數(shù)能表達(dá)的數(shù)據(jù)范圍為+127—128。
二進(jìn)制負(fù)數(shù)的反碼就是機(jī)器數(shù)符號(hào)位保持不變,其他各位按位取反。
8086CPU是16位微處理器,內(nèi)部對(duì)外有16位數(shù)據(jù)總線。8086CPU有20位地址總線,直接尋址空間為1MB。
8086有一種初級(jí)流水線構(gòu)造,內(nèi)部操作與對(duì)外操作具有并行性。
8088CPU是準(zhǔn)16位微處理器,由于它的內(nèi)部有16位數(shù)據(jù)總線,但對(duì)外只有8位數(shù)據(jù)總線。
BusInterfaceUnit,BIU總線接口部件由段寄存器、指令指針寄存器、總線控制邏輯、地址加法器、指令隊(duì)列等單
元構(gòu)成,BIU功能;地址形成、取指令、指令排隊(duì)、讀/寫(xiě)操作數(shù)、總線控制。
IP總是指向下一條將要執(zhí)行的指令。
當(dāng)指令隊(duì)列有2個(gè)或2個(gè)以上字節(jié)空時(shí),BIU會(huì)自動(dòng)存取指令。
ExecutionUnit,EU執(zhí)行部件EU的構(gòu)成:算術(shù)邏輯單元ALU、寄存器組、標(biāo)志寄存器、暫存器、EU控制電路。
EU的重要任務(wù):指令譯碼、執(zhí)行指令。
指令次序執(zhí)行時(shí),EU和BIU是并行工作方式;若碰到轉(zhuǎn)移指令、調(diào)用指令和返回指令時(shí),要將指令隊(duì)列中的指令
作廢,由BIU重新取轉(zhuǎn)移目的地址中的新指令,EU才能繼續(xù)執(zhí)行指令,并行操作將受到影響。
8086CPU的BIU和EU并行工作的過(guò)程:EU的功能是執(zhí)行指令。EU從指令隊(duì)列中取出指令編碼,將其譯碼,發(fā)
出對(duì)應(yīng)的控制信息。控制數(shù)據(jù)在ALU中進(jìn)行運(yùn)算,運(yùn)算成果的特性保留在標(biāo)志寄存器PSW中。BIU的功能是負(fù)
責(zé)與存儲(chǔ)器、I/O端口傳送信息。當(dāng)EU從指令隊(duì)列中取走指令,指令隊(duì)列出現(xiàn)空字節(jié)(8086指令隊(duì)列為6個(gè)字節(jié)
中空出2個(gè)字節(jié),8088指令隊(duì)列為4個(gè)字節(jié)空出1個(gè)字節(jié))時(shí),BIU即從內(nèi)存中取出后續(xù)的指令代碼放入隊(duì)列
中;當(dāng)EU需要數(shù)據(jù)時(shí),BIU根據(jù)EU給出的邏輯地址,在地址加法器中完畢20位物理地址的計(jì)算,從指定的內(nèi)
存單元或外設(shè)中取出數(shù)據(jù)供EU使用:當(dāng)運(yùn)算結(jié)束時(shí),BIU將運(yùn)算成果送入指定的內(nèi)存單元和外設(shè)。當(dāng)隊(duì)列空時(shí),
EU就等待直到有指令為止。
CPU內(nèi)部可用來(lái)提供地址信息的寄存器都是16位的,8086/8088采用了段構(gòu)造的內(nèi)存管理的措施:20位物理地址
二段地址*16+偏移地址。
AX,AL(隱含):在乘法指令中,寄存乘數(shù)或乘積,在除法指令中寄存除數(shù)或商。
AH(隱含):在LAHF指令中,做目的寄存器。
AL(隱含):在十進(jìn)制運(yùn)算指令中做累加器;在XLAT指令中作累加器用。
BX(隱含):在XLAT指令中作基址寄存器。
CX(隱含):在LOOP指令和串操作指令中作計(jì)數(shù)器,可使程序指令簡(jiǎn)化,有助于提高程序的運(yùn)行速度。
DX(隱含):在做字乘/除法運(yùn)算時(shí),DX寄存乘積高位或被除數(shù)高位或余數(shù)。
SI寄存源串在數(shù)據(jù)段內(nèi)的偏移地址,DI寄存目的串在附加數(shù)據(jù)段內(nèi)的偏移地址。
當(dāng)CPU取出指令代碼的一種字節(jié)后,IP自動(dòng)加1,指向指令代碼的下一種字節(jié)。顧客程序不能直接訪問(wèn)IP。指令
的物理地址=CS*I6+IP。
若最高位發(fā)生進(jìn)位(或借位)則CF=1,否則CF=0o
當(dāng)運(yùn)算成果低8位中具有偶數(shù)個(gè)1時(shí),PF=1,否則PF=0o
成果的低4位向高4位有進(jìn)位(或借位),則AW1,否則A卜二U.
若將TF置1,8086/8088CPU處在單步工作方式,CPU每執(zhí)行完一條指令,就會(huì)自動(dòng)產(chǎn)生一次內(nèi)部中斷,使顧客
能逐條跟蹤程序。否則,將正常執(zhí)行程序。
DF=1(STD指令),地址指針自動(dòng)減量,即由高地址向低地址進(jìn)行串操作。
8086/8088芯片:雙列直插式封裝。40條引腳,部分引腳分時(shí)復(fù)用。
最小模式:?jiǎn)螜C(jī)系統(tǒng),所有控制信號(hào)由8086提供。最大模式:多處理機(jī)系統(tǒng),系統(tǒng)所需的控制信號(hào)由8288提
供。在最小模式系統(tǒng)配置中,除了8086CPU、存儲(chǔ)器、I/O接口芯片外,還要加入:1片8284A作為8086/8088系
統(tǒng)的時(shí)鐘發(fā)生器:3片Intel8282/8283或74LS373/74LS273作為地址鎖存器,用以鎖存目前的地址信號(hào);2片Intel
8286/8287或74LS245作為數(shù)據(jù)收發(fā)器(總線收發(fā)器)。
最大工作模式:系統(tǒng)中有兩個(gè)或多種微處理器,其中有一種是主處理器8086,其他的處理器稱為協(xié)處理器,它們
協(xié)助主處理器工作。
DEN(DaiaEnable)數(shù)據(jù)容許信號(hào),三態(tài),輸出。
ALE(AddressLatchEnable)地址鎖存容許信號(hào),輸出。
DT/R(DataTransmit/Receive)數(shù)據(jù)發(fā)送/接受控制信號(hào)。
RESET(Reset)復(fù)位信號(hào),高電平有效,輸入,此信號(hào)至少保持4個(gè)時(shí)鐘周期以上的高電平,當(dāng)RESET變低電平
時(shí),CPU執(zhí)行重啟過(guò)程,8086/8088重啟后,從地址FFFF0H開(kāi)始執(zhí)行指令,一般此地址放一條無(wú)條件轉(zhuǎn)移指令,
將入口轉(zhuǎn)到引導(dǎo)和裝配程序。
HOLD(HoldRequest)總線保持祈求信號(hào),輸入,高電平有效,在最小模式系統(tǒng)中,HOLD有效,表達(dá)其他共享總
線的部件向CPU祈求使用總線。規(guī)定直接與存儲(chǔ)器傳送數(shù)據(jù).
HLDA(HoldAcknowledge)總線保持響應(yīng)信號(hào),輸出,高電平有效,表達(dá)CPU容許讓出總線使用權(quán),并將三條總
線置成高阻狀態(tài)??偩€祈求部件獲得總線使用權(quán)后,可進(jìn)行總線慷作(DMA數(shù)據(jù)傳送),總線使用完畢后使
HOLD無(wú)效,CPU將HLDA置成低電平,收回總線使用權(quán)。
8086與8088的區(qū)別:8086為16位微處理器,而8088是準(zhǔn)16位微處理器,其內(nèi)部運(yùn)算為16位,但外部數(shù)據(jù)總線
是8位。從內(nèi)部構(gòu)造上:8086的指令隊(duì)列有6個(gè)字節(jié),出現(xiàn)2個(gè)空閑字節(jié),BIU就訪問(wèn)存儲(chǔ)器取指。8088只有4
個(gè)字節(jié),只要指令隊(duì)列出現(xiàn)1個(gè)空閑字節(jié),BIU就會(huì)訪問(wèn)存儲(chǔ)器取指。存儲(chǔ)器組織8086把1MB的內(nèi)存空間提成兩
個(gè)部分:偶地址存貯單元和奇地址存貯單元,分別由A0信號(hào)和BHE信號(hào)選通。8088對(duì)整個(gè)內(nèi)存空間不分奇偶。
代碼段寄存器CS---寄存目前代碼段的段基址。
數(shù)據(jù)段存存器DS--寄存目前數(shù)據(jù)段的段基址。
堆棧段寄存器SS……寄存H前堆棧段的段基址。
附加段寄存器ES---寄存目前附加段的段基址。
一旦這四個(gè)段寄存器的內(nèi)容被設(shè)定,就規(guī)定/CPU目前可尋址的段。
8086系統(tǒng)中的堆棧段是由段定義語(yǔ)句在存儲(chǔ)器中定義的一種段,堆棧段容量不不小于等于64K字節(jié)。段基址由堆
棧寄存器SS指定,棧頂由堆棧指針SP指定。當(dāng)堆棧置空時(shí),SP指向棧底。堆棧地址由高向低增長(zhǎng),棧底設(shè)在存
儲(chǔ)器的高地址區(qū)。
一種端口對(duì)應(yīng)I/O芯片內(nèi)部的?種寄存器或?組寄存器。8086容許64K(65535個(gè))個(gè)I/O端口,用地址總線的低
16位ADI5?AD0對(duì)端口進(jìn)行編址。
8086的時(shí)鐘頻率為5MHZ,1個(gè)時(shí)鐘周期就是200nSo
經(jīng)典的總線周期至少由4個(gè)T狀態(tài)構(gòu)成,分別以Tl、T2、T3、T4來(lái)表達(dá),T1狀態(tài):傳送地址,T2-T4狀態(tài):傳
送數(shù)據(jù),
8086CPU復(fù)位條件:RESET信號(hào)脈沖寬度不低于4個(gè)時(shí)鐘周期。
T1狀態(tài):輸出20位地址A19~A0。
T2狀態(tài):地址信息消失,A19-A16從地址信息變?yōu)闋顟B(tài)信息S6-S3o
T3狀態(tài):CPU采樣READY信號(hào),若無(wú)效,則CPU插入I個(gè)或幾種Tw等待狀態(tài),直至READY有效,數(shù)據(jù)總線
上出現(xiàn)數(shù)據(jù)。
T4狀態(tài):在T4后半期,撤除數(shù)據(jù),各控制和狀態(tài)信號(hào)線進(jìn)入無(wú)效狀態(tài)。該總線周期結(jié)束。
Tw:當(dāng)存儲(chǔ)器或I/O接口速度不夠時(shí),T3與T4之間可插入等待狀態(tài)Tw。
Ti:當(dāng)BIU無(wú)訪問(wèn)操作數(shù)和取指令的任務(wù)時(shí),總線接口部件不和總線打交道,8086就進(jìn)入了總線空閑周期Ti。
此時(shí),CPU對(duì)總線進(jìn)行空操作,但CPU內(nèi)部操作仍在進(jìn)行。Ti可當(dāng)作是BIU對(duì)EU的等待。
立即尋址:操作數(shù)直接包括在指令中。MOVAX,3000Ho立即數(shù)只能作源操作數(shù),不能作目的操作數(shù)。
寄存器尋址方式:操作數(shù)包括在寄存器中。MOVBX,AX。源操作數(shù)的長(zhǎng)度必須與目的操作數(shù)?致。CS不能用
MOV指令修改。寄存器可作源操作數(shù)或目的操作數(shù),或同步作兩個(gè)操作數(shù)。
直接尋址方式:操作數(shù)在存儲(chǔ)器中。無(wú)段超越前綴:MOVAX,[H]o有段超越前綴:MOVAX,ES:[500H],>符號(hào)
地址:MOVAX,AREAlo
寄存器間接尋址:操作數(shù)在存儲(chǔ)器中,操作數(shù)的有效地址包括在指令給出的寄存器中。MOVBX,|DI]o只有BX、
BP、SI、DI可用于間接尋址。在無(wú)段超越前綴的狀況下:使用BX,SLDI時(shí),默認(rèn)段基址由DS給出,使用
BP,默認(rèn)段基址由SS給出。
寄存器相對(duì)尋址:操作數(shù)在存儲(chǔ)器中,操作數(shù)的有效地址是一種基址/變址寄存器的內(nèi)容與指令中指定的8位或16
位位移量之和。
基址變址尋址:操作數(shù)在存儲(chǔ)器中,操作數(shù)有效地址;基址寄存器內(nèi)容+變址寄存器內(nèi)容。MOVAX,[BX][SI],
MOVAX,[BP][DI]O若基址寄存器為BX時(shí),段寄存器使用DS。若基址寄存器為BP時(shí),段寄存器使用SS。
相對(duì)基址變址尋址:MOVAX,COUNT[BX][DI]
通用寄存器:AX合計(jì)器、BX基址寄存器、CX計(jì)數(shù)器、DX數(shù)據(jù)寄存器。
指針和變址寄存器:SP堆棧指針寄存器、BP基址指針寄存器、SI源變址寄存器、DI目的變址寄存器。
指令性語(yǔ)句:不能以數(shù)字開(kāi)頭,長(zhǎng)度W3I個(gè)字符。偽指令語(yǔ)句:沒(méi)有對(duì)應(yīng)的機(jī)器碼,在匯編源程序時(shí)被處理。操作數(shù):
假如開(kāi)頭字母的A~F,則需在數(shù)值前加0。如:OFFHo
TYPE變量/標(biāo)號(hào)若為變量,返回變量的類型屬性。(字節(jié),字,雙字,四字變量分別對(duì)應(yīng)返回值1,2,4,8)。若
為標(biāo)號(hào),返回標(biāo)號(hào)的距離屬性,返回值-l(FFH),-2(FEH)分別對(duì)應(yīng)類型為近標(biāo)號(hào),遠(yuǎn)標(biāo)號(hào)。
LENGTH變量當(dāng)變量用DUP定義時(shí),返回其包括的單元數(shù),對(duì)其他變量則返回1。
SIZE變量返回SIZE=LENGTH*TYP。
類型/距離PTR變量或標(biāo)號(hào)將PTR左邊的類型/距離屬性賦給右邊的變量/標(biāo)號(hào)。
用DVV定義字符串時(shí),只容許包括兩個(gè)字符,多于兩個(gè)字符時(shí),只能用DB定義。例:FIRSTDB4HELLO\
SECONDDW'OK,。
定義堆棧段一般這樣:STACKSEGMENTSTACK'STACK,;組合類型不能省略。
ORG體現(xiàn)式指定下面語(yǔ)句的起始偏移地址。
宏是源程序中一段具有獨(dú)立功能的程序代碼。它只需要定義一次,就可以用宏指令語(yǔ)句多次調(diào)用。I.宏調(diào)用是在匯
編期間進(jìn)行,子程序則在程序執(zhí)行期間執(zhí)行。2.子程序調(diào)用每次都需保留現(xiàn)場(chǎng),恢復(fù)現(xiàn)場(chǎng),執(zhí)行速度慢;宏調(diào)川則
不需此項(xiàng)工作,節(jié)省時(shí)間,速度快。3.子程序這組指令的機(jī)器碼在存儲(chǔ)器中只寄存一次,而宏調(diào)用所占存儲(chǔ)空間與
調(diào)用次數(shù)有關(guān),次數(shù)越多,所占空間越大。若有多次調(diào)用的程序較長(zhǎng),速度規(guī)定不高,合適采用子程序,可節(jié)省
程序空若多次調(diào)用的程序較短,需傳遞的參數(shù)較多時(shí)或操作但愿修改時(shí),合適采用宏調(diào)用。
當(dāng)主程序(調(diào)用程序)和過(guò)程在同一代碼段中,則使用NEAR屬性,若不在同一代碼段中,則使用FAR屬性。
RAM隨機(jī)存取存儲(chǔ)器,隨機(jī)存取存儲(chǔ)器,隨機(jī)讀寫(xiě),斷電后數(shù)據(jù)消失。靜態(tài)RAM(6264)集成度低,速度快,
功耗較大,一般用做高速緩存(Cache)。動(dòng)態(tài)RAM(2164),存儲(chǔ)原理:動(dòng)態(tài)RAM依托電容C存儲(chǔ)電荷的狀
況來(lái)決定寄存信息是“1”或“0”。電容會(huì)緩慢放電而導(dǎo)致信息的丟失必須定期對(duì)電容充電,稱為刷新,兩次刷
新的時(shí)間間隔與溫度有關(guān),經(jīng)典的刷新時(shí)間間隔為2ms,刷新是一行一行進(jìn)行的,每刷新一行的時(shí)間稱為刷新周
期。刷新和地址兩次打入是DRAM芯片的重要特點(diǎn)。密度高,速度慢,成本低。微機(jī)中的內(nèi)存條由DRAM做。
位擴(kuò)展法-當(dāng)存儲(chǔ)芯片所能提供的數(shù)據(jù)位數(shù)不能滿足存儲(chǔ)器系統(tǒng)的字長(zhǎng)規(guī)定期,果用位擴(kuò)展法進(jìn)行擴(kuò)展。擴(kuò)展措
施:三總線對(duì)接:1、各芯片的數(shù)據(jù)線分別接到數(shù)據(jù)總線的各位上;2、各芯片的地址線并接在一起,連到對(duì)應(yīng)的
地址總線各位;3、各芯片的控制線并接在一起,連到對(duì)應(yīng)的控制線上。偶地址由A0做片選信號(hào),數(shù)據(jù)為低8
位,基地址由BHE非做片選信號(hào),數(shù)據(jù)為高8位。
字?jǐn)U展法-用存儲(chǔ)容量較小的芯片構(gòu)成容量較大的存儲(chǔ)器,擴(kuò)大容量。擴(kuò)展措施:1、各存儲(chǔ)芯片片內(nèi)地址線接到
AB上的低位。2、存儲(chǔ)芯片的片選用AB的高位線來(lái)做。3、各存儲(chǔ)芯片的數(shù)據(jù)線、控制線接法一致,均并接對(duì)應(yīng)
的總線上。
I/O通信是計(jì)算機(jī)與外設(shè)間的互換數(shù)據(jù)(數(shù)字量、模擬量、開(kāi)關(guān)量)、狀態(tài)(準(zhǔn)備就緒位、忙碌位、錯(cuò)誤位)和控
制命令(CPU向接口發(fā)出的多種命令和控制字)的過(guò)程。計(jì)算機(jī)和外設(shè)之間信息互換存在:速度不匹配、信號(hào)電
平不匹配、信號(hào)格式不匹配、時(shí)序不匹配。I/O接口與外設(shè)交互三種信息時(shí):均是通過(guò)DB來(lái)完畢.每個(gè)接口部件
都包括一組寄存器。在進(jìn)入端口時(shí),不一樣的信息進(jìn)不一樣的寄存器(端口)。
I/O接口一把外圍設(shè)備同微型計(jì)算機(jī)連接起來(lái)實(shí)現(xiàn)數(shù)據(jù)傳送的控邕也壁稱為“外設(shè)接口電路”,即I/O接口。
I/O端口——I/O接口中可以由CPU進(jìn)行讀或?qū)懙某b被稱為“端口”。
每個(gè)I/O端口有?種地址,即端口地址。CPU對(duì)外設(shè)的訪問(wèn)實(shí)質(zhì).上.是對(duì)接口中對(duì)應(yīng)端口進(jìn)行訪問(wèn)。?般接口電路
中要設(shè)置如下幾種端口:1)數(shù)據(jù)端匚:寄存外設(shè)送往CPU的數(shù)據(jù)以及CPU要輸出到外設(shè)去的數(shù)據(jù)。2)狀態(tài)端
口:用來(lái)指示外設(shè)的目前狀態(tài)。3)控制端口:用來(lái)寄存CPU向接口發(fā)出的多種命令和控制字。
CPU在同時(shí)亥職能選中某?種I/O端口,因此和存儲(chǔ)器同樣,也需要由譯碼電路來(lái)形成I/O端口地址。I/O端口
的編址方式有兩種:存儲(chǔ)器映像編址方式、I/O單獨(dú)編址方式。
存儲(chǔ)器映像編址方式:把系統(tǒng)中的每一種I/O端口都看作一種存儲(chǔ)單元,并與存儲(chǔ)單元同樣統(tǒng)一編址,這樣訪問(wèn)存
儲(chǔ)器的所有指令均可用來(lái)訪問(wèn)I/O端口,這種尋址方式稱為存儲(chǔ)器映像的I/O尋址方式。特點(diǎn):占用存儲(chǔ)空間、無(wú)
專門(mén)的輸入/輸出指令、能用類型多、功能強(qiáng)的訪問(wèn)存儲(chǔ)器指令,對(duì)I/O設(shè)備進(jìn)行以便、靈活的操作。
I/O單獨(dú)編址方式:對(duì)系統(tǒng)中的輸入輸出端口地址單獨(dú)編址,構(gòu)成一種I/O空間,它們不占用存儲(chǔ)空間,而是用專
門(mén)的指令來(lái)訪問(wèn)這種具有獨(dú)立地址空間的端口。有專門(mén)的I/O指令,但I(xiàn)/O指令的功能沒(méi)有訪問(wèn)存儲(chǔ)器的指令強(qiáng)。
接口的編址空間獨(dú)立,不會(huì)對(duì)存儲(chǔ)器空間導(dǎo)致影響。I/O指令長(zhǎng)度短,速度快。CPU需提供能辨別訪問(wèn)內(nèi)存和訪問(wèn)
I/O端口的硬件引腳信號(hào)。
8086/8088微處理器采用I/O單獨(dú)編址方式訪問(wèn)外設(shè),用地址總線的低16位(AD15?ADO)來(lái)尋升I/O端口,最
多可訪問(wèn)65536個(gè)輸入或輸出端口。
CPU與外設(shè)的數(shù)據(jù)傳送方式:程序控制方式、中斷方式、DMA方式。
程序控制方式,可分為:無(wú)條件傳送、條件傳送。無(wú)條件傳送方式(同步傳送方式):外設(shè)的多種動(dòng)作時(shí)間已知
或固定的狀況。程序設(shè)計(jì)簡(jiǎn)樸,直接由輸入/輸出指令實(shí)現(xiàn),軟、硬件開(kāi)銷小。規(guī)定在任何時(shí)刻或固定期刻外設(shè)均
已處在數(shù)據(jù)就緒或準(zhǔn)備接受的狀態(tài)。只合用于某些簡(jiǎn)樸外設(shè)的操作,如LED顯示屏、開(kāi)關(guān)等。往往需在DB上加
緩沖器或鎖存器。條件傳送方式(查詢式傳送方式),即先查詢外設(shè)狀態(tài),然后執(zhí)行輸入/輸出功能。外設(shè)的操作
完全由CPU控制,CPU為積極,外設(shè)為被動(dòng)。接口簡(jiǎn)便。CPU要不停地查詢外設(shè)的狀態(tài),當(dāng)外設(shè)未準(zhǔn)備好時(shí),
CPU就只能循環(huán)等待,不能執(zhí)行其他程序,這樣就揮霍了CPU的大量時(shí)間,減少了主:機(jī)的運(yùn)用率。合用于以輸出
為主,CPU自身處理的信息量不大的場(chǎng)所。
中斷方式:當(dāng)外設(shè)準(zhǔn)備好,向CPU發(fā)出中斷祈求。CPU在滿足響應(yīng)中斷的條件下,發(fā)出中斷響應(yīng)信號(hào)。CPU暫停
目前途序,轉(zhuǎn)去執(zhí)行中斷服務(wù)程序,完畢與外設(shè)的數(shù)據(jù)傳送。CPU從中斷服務(wù)程序返回,繼續(xù)執(zhí)行被中斷的程
序。CPU與外設(shè)處在并行工作狀態(tài)。CPU不必檢測(cè)外部狀態(tài),效率C高??蓪?shí)現(xiàn)優(yōu)先級(jí)控制。
DMA傳送方式:當(dāng)外設(shè)需傳送數(shù)據(jù)時(shí),通過(guò)DMAC向CPU發(fā)出總線祈求。CPU發(fā)出總線響應(yīng)信號(hào),釋放總線。
MAC接管總線,控制外設(shè)、內(nèi)存之間直接數(shù)據(jù)傳送。外設(shè)和內(nèi)存之間,直接進(jìn)行數(shù)據(jù)傳送,不通過(guò)CPU,傳送效
率高。合用于在內(nèi)存與高速外設(shè)、或兩個(gè)高速外設(shè)之間進(jìn)行大批量數(shù)據(jù)傳送。電路構(gòu)造復(fù)雜,硬件開(kāi)銷較大。
用于各部件之間傳送信息的公共通路,稱總線??偩€分類1?片級(jí)總線:地址、數(shù)據(jù)、控制總線。2.系統(tǒng)總線:板卡
間的總線。3.外部總線:機(jī)器間的總線。
CPU在每條指令的最終一種T周期去檢測(cè)INTR引腳,若有中斷祈求,則在IF=I的條件下,響應(yīng)中斷,向外設(shè)發(fā)
出INTA中斷響應(yīng)信號(hào),并保護(hù)斷點(diǎn)(目前CS、IP和FLAG值入棧),繼而轉(zhuǎn)去執(zhí)行中斷服務(wù)子程序,中斷服務(wù)
程序執(zhí)行完畢,返回原程序被中斷處繼續(xù)執(zhí)行。
中斷響應(yīng)過(guò)程:CPU響應(yīng)中斷后,對(duì)中斷接口電路發(fā)出兩個(gè)中斷響應(yīng)信號(hào)INTA,中斷接口電路收到第二個(gè)INTA
后,通過(guò)數(shù)據(jù)線向CPU送中斷類型號(hào)。CPU自動(dòng)完畢如下工作:1.CPU從數(shù)據(jù)總線上讀取中斷類型號(hào)。2.Flags進(jìn)
棧。3.標(biāo)志IF清0(關(guān)中斷,屏蔽其他外部中斷祈求),標(biāo)志TF清0(關(guān)單步中斷,以防止CPU以單步方式執(zhí)行
中斷處理子程序)。4.保護(hù)斷點(diǎn):目前CS及IP進(jìn)棧。5.根據(jù)中斷類型號(hào),杳中斷向量表,轉(zhuǎn)中斷服務(wù)子程序。6.
中斷處理程序結(jié)束后,從堆棧依次彈出IP,CS,Flags,返回?cái)帱c(diǎn)處繼續(xù)執(zhí)行本來(lái)的程序。
軟件中斷不受IF標(biāo)志的影響。
8086/8088系統(tǒng)容許處理256類中斷,對(duì)應(yīng)中斷類型號(hào)為0-255。在存儲(chǔ)器的OOOOOH~0003FFH,占用1K字節(jié)空
間,用作寄存中斷向量。每個(gè)類型號(hào)占4個(gè)字節(jié),高2個(gè)字節(jié)寄存中斷服務(wù)程序入口地址的段地址,低2個(gè)字節(jié)
寄存該入口地址的段內(nèi)偏移地址。
尚有兩塊芯片沒(méi)有寫(xiě),分別是8255A、8259A,請(qǐng)自行腦補(bǔ)。此外就是三八譯碼器也很重要,內(nèi)存的地址分派幾乎
是必考。學(xué)長(zhǎng)只能協(xié)助到這里了,請(qǐng)加油!
(根據(jù)付老師課件整頓,合用于昆工期末考和考研!?。?/p>
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